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單片機(jī)上拉電阻、下拉電阻的詳解和選?。ㄒ唬?/h2>

發(fā)布時(shí)間:2019-11-22 責(zé)任編輯:lina

【導(dǎo)讀】上拉就是將不確定的信號(hào)通過一個(gè)電阻嵌位在高電平,電阻同時(shí)起限流作用。下拉同理。上拉是對(duì)器件注入電流,下拉是輸出電流。弱強(qiáng)只是上拉電阻的阻值不同,沒有什么嚴(yán)格區(qū)分。對(duì)于非集電極(或漏極)開路輸出型電路(如普通門電路),提升電流和電壓的能力是有限的,上拉電阻的功能主要是為集電極開路輸出型電路提供電流通道。
 
單片機(jī)上拉電阻、下拉電阻的詳解和選取(一)

一. 定義

1、上拉就是將不確定的信號(hào)通過一個(gè)電阻嵌位在高電平,電阻同時(shí)起限流作用。下拉同理。

2、上拉是對(duì)器件注入電流,下拉是輸出電流。

3、弱強(qiáng)只是上拉電阻的阻值不同,沒有什么嚴(yán)格區(qū)分。

4、對(duì)于非集電極(或漏極)開路輸出型電路(如普通門電路),提升電流和電壓的能力是有限的,上拉電阻的功能主要是為集電極開路輸出型電路提供電流通道。

二. 上、下拉電阻作用

1、一般作單鍵觸發(fā)使用時(shí),如果IC本身沒有內(nèi)接電阻,為了使單鍵維持在不被觸發(fā)的狀態(tài)或是觸發(fā)后回到原狀態(tài),必須在IC外部另接一個(gè)電阻。

2、數(shù)字電路有三種狀態(tài):高電平、低電平和高阻狀態(tài)。有些應(yīng)用場(chǎng)合不希望出現(xiàn)高阻狀態(tài),可以通過上拉電阻或下拉電阻的方式使其處于穩(wěn)定狀態(tài),具體視設(shè)計(jì)要求而定。

3、一般說的是I/O端口,有的可以設(shè)置,有的不可以設(shè)置,有的是內(nèi)置,有的是需要外接。I/O端口的輸出類似于一個(gè)三極管的C,當(dāng)C接通一個(gè)電阻和電源連接在一起的時(shí)候,該電阻成為上拉電阻。也就是說,如果該端口正常時(shí)為高電平,C通過一個(gè)電阻和地連接在一起的時(shí)候,該電阻成為下拉電阻,使該端口平時(shí)為低電平。比如:當(dāng)一個(gè)接有上拉電阻的端口設(shè)為輸入狀態(tài)時(shí),它的常態(tài)就為高電平,用于檢測(cè)低電平的輸入。

4、上拉電阻是用來解決總線驅(qū)動(dòng)能力不足時(shí)提供電流的。一般說法是拉電流,下拉電阻是用來吸收電流的,也就是我們通常所說的灌電流。

5、接電阻就是為了防止輸入端懸空。

6、減弱外部電流對(duì)芯片產(chǎn)生的干擾。

7、保護(hù)CMOS內(nèi)的保護(hù)二極管,一般電流不大于10mA。

8、通過上拉或下拉來增加或減小驅(qū)動(dòng)電流。

9、改變電平的電位,常用在TTL-CMOS匹配。

10、在引腳懸空時(shí)有確定的狀態(tài)。

11、增加高電平輸出時(shí)的驅(qū)動(dòng)能力。

12、為OC門提供電流。

三. 上拉電阻應(yīng)用原則

1、當(dāng)TTL電路驅(qū)動(dòng)COMS電路時(shí),如果TTL電路輸出的高電平低于COMS電路的最低高電平(一般為3.5V),這時(shí)就需要在TTL的輸出端接上拉電阻,以提高輸出高電平的值。

2、OC門電路“必須加上拉電阻,才能使用”。

3、為加大輸出引腳的驅(qū)動(dòng)能力,有的單片機(jī)管腳上也常使用上拉電阻。

4、在COMS芯片上,為了防止靜電造成損壞,不用的管腳不能懸空,一般接上拉電阻產(chǎn)生降低輸入阻抗,提供泄荷通路。

5、芯片的管腳加上拉電阻來提高輸出電平,從而提高芯片輸入信號(hào)的噪聲容限以增強(qiáng)抗干擾能力。

6、提高總線的抗電磁干擾能力。管腳懸空就比較容易接受外界的電磁干擾。

7、長(zhǎng)線傳輸中電阻不匹配容易引起反射波干擾,加上下拉電阻是電阻匹配,有效的抑制反射波干擾。

8、在數(shù)字電路中不用的輸入腳都要接固定電平,通過1k電阻接高電平或接地。
 
 
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