本文基于以下三個(gè)前提：

 

1、利用TDR (時(shí)域反射計(jì))減小探頭誤差。TDR通常用來(lái)測(cè)量信號(hào)通路長(zhǎng)度與阻抗變化的關(guān)系。TDR也是測(cè)量傳輸延時(shí)的重要工具。

 

2、避免直接探測(cè)。由于加載的原因，有源探頭會(huì)使測(cè)量變得復(fù)雜，并引入誤差。

 

3、利用一個(gè)實(shí)例演示這一方法。本文將以MAX9979為例，該芯片為高速引腳電子電路，適合于A(yíng)TE系統(tǒng)。芯片內(nèi)部集成了雙路高速驅(qū)動(dòng)器、有源負(fù)載以及工作在1Gbps以上的窗比較器。

此處介紹的方法適用于任何高速器件。

 

 

TDR測(cè)試方法中，沿信號(hào)通路傳輸高速信號(hào)邊沿，并觀(guān)察其反射信號(hào)。反射能夠說(shuō)明信號(hào)通路的阻抗以及阻抗變化時(shí)信號(hào)延時(shí)的變化，TDR測(cè)試的簡(jiǎn)單示意圖如圖1所示。

 

圖1. TDR原理，TDR測(cè)量基于反射系數(shù)ρ，其中ρ = (VREFLECTED/VINCIDENT)。最終，ZO = ρ × (1 + ρ)/(1 - ρ)。

 

從圖1可以得到兩個(gè)重要概念：

 

1、TDLY是我們將要測(cè)量的PCB (印刷電路板)引線(xiàn)延時(shí)。

 

2、ZO是被測(cè)PCB引線(xiàn)的阻抗。

 

 

為了測(cè)量納秒級(jí)的延時(shí)，需要非?？斓拿}沖發(fā)生器、高速示波器以及高速探頭。我們也可以利用具有TDR測(cè)量功能的Tektronix? 8000 (圖2)系列示波器(TDS8000、CSA8000或CSA8200)，配合80E04 TDR采樣模塊使用。本文采用MAX9979EVKIT (評(píng)估板)、Hewlett Packard 8082A脈沖發(fā)生器和TDS8000/80E04進(jìn)行演示。圖3所示為MAX9979EVKIT部分電路。可以選擇使用任何具有TDR功能的高速示波器和任何高速差分脈沖發(fā)生器，同樣能夠獲得相似結(jié)果。

 

圖2. Tektronix TDS8000系列具有采樣模式的示波器

 

圖3. MAX9979EVKIT (部分)

 

分析中將進(jìn)行以下測(cè)量：

 

 

 

由于人們對(duì)TDR響應(yīng)比較困惑，我們首先利用SPICE仿真器構(gòu)建輸入延時(shí)的模型。然后我們將仿真結(jié)果與實(shí)際測(cè)量進(jìn)行比較，參見(jiàn)圖4。

 

圖4. 等效輸入原理圖和最終仿真模型

 

圖4注釋?zhuān)?/div>

• PCB引線(xiàn)設(shè)定為6in長(zhǎng)，阻抗為65Ω。實(shí)際上，這是DATA1/NDATA1 PCB引線(xiàn)的真實(shí)阻抗。理想情況下為50Ω，但我們從TDR測(cè)量結(jié)果將會(huì)看到該值為63Ω。
• NDATA1輸出端接至地。由于DATA1和NDATA1對(duì)稱(chēng)，而且距離MAX9979引腳的長(zhǎng)度相同，所以?xún)H測(cè)量DATA1的PCB引線(xiàn)。
• 對(duì)信號(hào)發(fā)生器的12in電纜進(jìn)行建模，但實(shí)際傳輸延時(shí)測(cè)量證明并不需要這一建模。

• 輸入信號(hào)為階躍函數(shù)。這次仿真中，階躍幅度為0.5V。以此模擬CSA8000產(chǎn)生的TDR信號(hào)。
• 時(shí)間代表模型中不同單元的延時(shí)：

            a.第1級(jí)表示發(fā)生器的12in電纜。延時(shí)大約為3ns，是實(shí)際延時(shí)的兩倍。實(shí)際電纜延時(shí)為1.5ns。

            b.第2級(jí)表示DATA1 PCB引線(xiàn)。延時(shí)大約為2ns，PCB延時(shí)為該值的一半，或1ns。

• 其它延時(shí)為脈沖通過(guò)DATA1 PCB引線(xiàn)的反射。
• Y軸反映了不同元件的阻抗，單位為伏特，可轉(zhuǎn)換為阻抗。
• X軸為單次輸入階躍信號(hào)造成的模擬信號(hào)反射，參照?qǐng)D1對(duì)信號(hào)進(jìn)行比較。這些信號(hào)的長(zhǎng)度代表通過(guò)不同元件的延時(shí)。
•  

• 將2in長(zhǎng)SMA-SMA電纜連接至80E04 TDR模塊的一路輸入，另一端保持開(kāi)路。
• 利用TDR的下拉菜單進(jìn)行測(cè)量。
• 注意，這看起來(lái)很像圖1中的“開(kāi)路”示例。此處測(cè)得的延時(shí)為804ps，由于是兩倍的電纜延時(shí)，所以電纜延時(shí)為402ps。
• 還需注意的是，第2級(jí)階躍實(shí)際為頂部和底部之間的一半。根據(jù)TDR原理，表示2in長(zhǎng)度電纜實(shí)際阻抗為50Ω。
• 這條2in電纜是我們測(cè)量延時(shí)的通路之一。

• 圖7與圖5中的仿真曲線(xiàn)相同，證明了模型的準(zhǔn)確性。
• 光標(biāo)用于測(cè)量線(xiàn)路阻抗。第1級(jí)階躍為49.7Ω，代表CSA8000電纜。與我們的預(yù)期結(jié)果一致。
• 第二光標(biāo)顯示97.8Ω，為MAX9979內(nèi)部DATA1/NDATA1兩端的100Ω電阻(參見(jiàn)圖4)。與我們的預(yù)期結(jié)果一致。
• 第2級(jí)階躍阻抗不是50Ω。這一級(jí)為DATA1 PCB阻抗，大約為63Ω。這意味著DATA1和NDATA1的PCB引線(xiàn)不是我們所希望的50Ω。
• 大幅值為150Ω，是額外的50Ω電纜和100Ω電阻，只存在于第3級(jí)反射。

• 將12in SMA電纜的一端連接至CSA8000。將電纜另一端連接至MAX9979EVKIT的DATA1 SMA輸入連接器。
• 將NDATA1的SMA連接器通過(guò)SMA接地，從圖4可以看出這一點(diǎn)。12in SMA電纜的長(zhǎng)度與延時(shí)測(cè)量無(wú)關(guān)，但應(yīng)盡可能短。
• 無(wú)需對(duì)MAX9979EVKIT供電。該測(cè)量針對(duì)焊接到電路板上的MAX9979進(jìn)行，但不需要上電。有些用戶(hù)更喜歡使用沒(méi)有焊接器件的電路板進(jìn)行測(cè)量。斷開(kāi)MAX9979將產(chǎn)生更清晰的3級(jí)階躍信號(hào)，仿真圖1所示開(kāi)路狀態(tài)。兩種配置下，實(shí)際時(shí)間測(cè)量結(jié)果相同。

• 第1級(jí)階躍為電纜，我們對(duì)其延時(shí)并不感興趣。
• 測(cè)量值為1.39ns，PCB延時(shí)為該值的一半，或?yàn)?.695ns。這一延時(shí)確實(shí)大于模型的延時(shí)，但我們僅利用模型估算延時(shí)加以比較。
• 測(cè)量在信號(hào)的傾斜沿進(jìn)行。這些傾斜沿代表電路板SMA和MAX9979 DATA1引腳的電容效應(yīng)。因此，在這些傾斜沿之間進(jìn)行測(cè)量能夠確保測(cè)試結(jié)果包含了SMA和PIN延時(shí)。還需注意的是，波形中存在凸峰：這是SMA連接器與電路板之間的電感產(chǎn)生的。由此，需要在凸峰之前進(jìn)行測(cè)量，以確保獲取完整的電路板延時(shí)。進(jìn)一步的TDR測(cè)量讀數(shù)將突顯這些電容和電感造成的傾斜沿和凸峰。

• 第1級(jí)階躍表示2in電纜。TDR信號(hào)為0.5V，第1級(jí)階躍為250mV。說(shuō)明我們電纜的阻抗為50Ω，與預(yù)期情況一致。
• DUT1延時(shí)是在兩個(gè)傾斜沿之間進(jìn)行測(cè)量得到的，與上述DATA1測(cè)量說(shuō)明相同。然而，需要注意的是：這些傾斜沿之間的電平同樣為50Ω。該值表明較短的DUT1 PCB金屬線(xiàn)非常接近于理想的50Ω。
• 從上述內(nèi)容得到DATA1引線(xiàn)阻抗為63Ω，DUT1節(jié)點(diǎn)阻抗為50Ω。這意味著DATA1輸入的金屬線(xiàn)寬比DUT1輸出的線(xiàn)寬窄。理想情況下，它們應(yīng)該相同。TDR測(cè)量發(fā)現(xiàn)了這一差異，這不一定是系統(tǒng)錯(cuò)誤。DUT1引線(xiàn)阻抗稍高是由于較窄的金屬線(xiàn)造成的，但它同時(shí)也減小了DATA1金屬線(xiàn)的電容。數(shù)據(jù)線(xiàn)是最長(zhǎng)的引線(xiàn)，為了保證最寬頻帶的要求，該電容應(yīng)盡量小。
• DUT1的PCB延時(shí)很難測(cè)量，其阻抗與電纜相同。如果MAX9979沒(méi)有焊接到電路板上，我們將看到“開(kāi)路”狀態(tài)的三級(jí)階躍信號(hào)。但是，在焊接了MAX9979的條件下仍然可以測(cè)量到這一延時(shí)。通過(guò)檢查電容效應(yīng)產(chǎn)生的傾斜沿，可以看出SMA連接器在電路板的焊接位置以及MAX9979 DUT1引腳的位置。我們同樣可以查看SMA連接器電感產(chǎn)生的凸峰，確認(rèn)它處于兩個(gè)傾斜沿之間。解決了這些問(wèn)題，可以測(cè)得延時(shí)為360ps，將該值減半，得到實(shí)際DUT1 PCB電路板的延時(shí)，該延時(shí)為180ps。

• M1是差分信號(hào)C1 - C2的數(shù)學(xué)計(jì)算值，幅值為900mV，10%/90%上升和下降時(shí)間接近于700ps。這意味著DATA1/NDATA1信號(hào)上沒(méi)有任何干擾。
• 我們還對(duì)Crs或M1差分信號(hào)的過(guò)零點(diǎn)進(jìn)行測(cè)量，測(cè)得數(shù)據(jù)為29.56ns。觸發(fā)示波器，我們僅關(guān)注這些過(guò)零點(diǎn)中的一個(gè)。給MAX9979上電，然后測(cè)量相同過(guò)零點(diǎn)，因?yàn)樗峭ㄟ^(guò)整個(gè)電路板的延時(shí)。
• 該延時(shí)還包括兩條輸入電纜的延時(shí)，因?yàn)檫@些電纜也被用于測(cè)量通過(guò)電路板的信號(hào)延時(shí)，其延時(shí)相互抵消。盡管如此，最好還是使用盡可能短的電纜，只是該延時(shí)對(duì)傳輸延時(shí)測(cè)量并不重要。

• 當(dāng)前的輸出信號(hào)幅值為0V至1.5V，與預(yù)期情況一致，由于50Ω負(fù)載的存在而被除以2。
• 上升和下降時(shí)間完全在MAX9979的技術(shù)指標(biāo)范圍內(nèi)。由此，我們可以確認(rèn)由干凈、有效的DATA1/NDATA1驅(qū)動(dòng)產(chǎn)生完好、干凈、有效的輸出。
• CSA8000保持與第5步相同的設(shè)置，觸發(fā)方式與第4步相同。我們可以看到過(guò)零點(diǎn)為33.77ns。

• 減去0.695ns的DATA1 PCB引線(xiàn)延時(shí)，所得延時(shí)為3.515ns。
• 減去0.18ns的DUT1 PCB引線(xiàn)延時(shí)，所得延時(shí)為3.335ns。
• 減去CSA8000的2in電纜延時(shí)，該延時(shí)為402ps，所得延時(shí)為2.933ns。

• 傳輸延時(shí)測(cè)量結(jié)果非常準(zhǔn)確。
• 無(wú)需有源探頭(避免由此引入的誤差)。
• 簡(jiǎn)單技巧可用于絕大多數(shù)傳輸測(cè)量。
• 阻抗測(cè)量保證正確的連接器和PCB引線(xiàn)阻抗。
• 利用TDR信號(hào)能夠分析信號(hào)通路的附加電容和電感，必要時(shí)可作為重新設(shè)計(jì)的反饋信息。
• 簡(jiǎn)化模型和仿真工具確保獲得正確結(jié)果，并可驗(yàn)證測(cè)量配置。
• 采用良好的測(cè)試方法測(cè)量關(guān)鍵指標(biāo)。